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<project source="3.7.2" version="1.0">
This file is intended to be loaded by Logisim-evolution v3.7.2(https://github.com/logisim-evolution/).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
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<tool name="Pin">
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<lib desc="#Gates" name="1"/>
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<a name="appearance" val="classic"/>
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<lib desc="#I/O" name="5"/>
<lib desc="#TTL" name="6"/>
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<lib desc="#Input/Output-Extra" name="10"/>
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<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
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<mappings>
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</mappings>
<toolbar>
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<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
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<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
<sep/>
<tool lib="4" name="D Flip-Flop"/>
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</toolbar>
<circuit name="main">
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<a name="circuitnamedboxfixedsize" val="true"/>
<a name="simulationFrequency" val="2048000.0"/>
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<a name="incoming" val="24"/>
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<comp lib="0" loc="(250,1010)" name="Splitter">
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<a name="facing" val="west"/>
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<comp lib="0" loc="(510,830)" name="Splitter">
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<comp lib="1" loc="(920,580)" name="Controlled Buffer">
<a name="control" val="left"/>
<a name="facing" val="west"/>
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<comp lib="4" loc="(200,580)" name="ROM">
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40 800 0 0 40
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<comp lib="4" loc="(280,270)" name="Register">
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<comp lib="8" loc="(1340,969)" name="Text">
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<comp lib="8" loc="(537,909)" name="Text">
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<comp lib="8" loc="(570,1339)" name="Text">
<a name="text" val="11: RAM OUT 10: RAM IN 9: MAR IN 8: ALU OP 7:COUNTER INC 6: OPP OUT 5: R2 OUT 4: R2 IN 3: R1 OUT 2: R1 IN 1: ALU OUT"/>
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